[发明专利]互连线结构及互连线结构的形成方法有效
| 申请号： | 201210556457.1 | 申请日： | 2012-12-19 |
| 公开（公告）号： | CN103050439B | 公开（公告）日： | 2017-10-10 |
| 发明（设计）人： | 李乐 | 申请（专利权）人： | 上海华虹宏力半导体制造有限公司 |
| 主分类号： | H01L21/768 | 分类号： | H01L21/768;H01L23/538 |
| 代理公司： | 北京集佳知识产权代理有限公司11227 | 代理人： | 骆苏华 |
| 地址： | 201203 上海市浦东*** | 国省代码： | 上海;31 |
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| 摘要： | 一种互连线结构和互连线结构的形成方法，其中，互连线结构的形成方法包括提供半导体衬底，所述半导体衬底中形成有半导体器件；在所述半导体衬底上形成导电层；在所述导电层上形成掩模层；在形成掩模层后，在掩模层和导电层中形成沟槽，所述沟槽的深宽比范围大于0.8；在形成沟槽后，沉积金属间介质层，所述金属间介质层覆盖掩模层并填充沟槽，在沟槽内的金属间介质层中具有空气隙。本发明的导电层上形成掩模层，使得相邻互连线结构之间沟槽的深宽比（沟槽的高度与宽度比）增大，在相邻互连线结构之间形成较大的空气隙，使得相邻互连线之间的介电常数明显减小，显著减小了相邻互连线结构之间的寄生电容，提高了半导体器件的性能。 | ||
| 搜索关键词： | 互连 结构 形成 方法 | ||
【主权项】：
一种互连线结构的形成方法，其特征在于，包括：提供半导体衬底，所述半导体衬底上形成有半导体器件；在所述半导体衬底上形成导电层，所述导电层用于形成金属互连线结构；在所述导电层上形成掩模层；在形成掩模层后，在导电层和导电层上方的掩膜层中形成沟槽，所述沟槽的深宽比范围大于0.8；在形成所述沟槽后，沉积金属间介质层，所述金属间介质层覆盖导电层上方的所述掩模层并填充沟槽，在所述沟槽内的金属间介质层中具有空气隙。
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H01 基本电气元件
H01L 半导体器件；其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置；专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理；集成电路器件或其特殊部件的制造
H01L 半导体器件；其他类目中不包括的电固体器件
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H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
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