[发明专利]一种半导体结构及其制造方法有效
申请号: | 201110362350.9 | 申请日: | 2011-11-15 |
公开(公告)号: | CN103107091A | 公开(公告)日: | 2013-05-15 |
发明(设计)人: | 尹海洲;蒋葳;许高博 | 申请(专利权)人: | 中国科学院微电子研究所 |
主分类号: | H01L21/336 | 分类号: | H01L21/336;H01L21/28;H01L21/768;H01L29/78;H01L29/45 |
代理公司: | 北京汉昊知识产权代理事务所(普通合伙) 11370 | 代理人: | 朱海波 |
地址: | 100029 *** | 国省代码: | 北京;11 |
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摘要: | 本发明提供一种半导体结构的制造方法和相应的半导体器件。在替代栅工艺中通过在源漏区上方形成掺杂多晶硅层,形成贯穿层间介质层(300)和所述非晶硅层(251)的接触孔(310),所述接触孔(310)至少部分暴露所述源/漏区(110),并在所述源/漏区的暴露区域和接触孔在非晶硅层中的侧壁表面形成接触层,降低了所述源/漏区的接触电阻。由于接触层在对高K介质层进行退火后形成,所以避免了金属硅化物层在高温下被破坏。 | ||
搜索关键词: | 一种 半导体 结构 及其 制造 方法 | ||
【主权项】:
一种半导体结构的制造方法,该方法包括以下步骤:a)提供衬底(100);b)在所述衬底(100)上形成伪栅堆叠、附着于所述伪栅堆叠侧壁的侧墙(240)、以及位于所述伪栅堆叠两侧的源/漏区(110),其中所述伪栅堆叠至少包括第一栅极介质层和伪栅极(220);c)在所述源/漏区(110)表面形成与所述源/漏区同型掺杂的非晶硅层(251);d)形成覆盖所述掺杂非晶硅层(251)以及伪栅堆叠的层间介质层(300);e)去除所述层间介质层(300)的一部分以暴露所述伪栅堆叠;f)去除所述伪栅堆叠以形成开口,在所述开口(260)内填充第二栅介质层和所述第一导电材料(280),以形成栅堆叠结构,或者去除所述伪栅堆叠在第一栅极介质层以上的部分以形成开口,在所述开口(260)内填充所述第一导电材料(280),以形成栅堆叠结构;g)形成贯穿层间介质层(300)和所述非晶硅层(251)的接触孔(310),所述接触孔(310)至少部分暴露所述源/漏区(110);h)在所述源/漏区(110)的暴露区域和接触孔(310)在非晶硅层(251)中的侧壁表面形成接触层(111);i)在所述接触孔中填充第二导电材料,形成接触塞(320)。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造
H01L 半导体器件;其他类目中不包括的电固体器件
H01L21-00 专门适用于制造或处理半导体或固体器件或其部件的方法或设备
H01L21-02 .半导体器件或其部件的制造或处理
H01L21-64 .非专门适用于包含在H01L 31/00至H01L 51/00各组的单个器件所使用的除半导体器件之外的固体器件或其部件的制造或处理
H01L21-66 .在制造或处理过程中的测试或测量
H01L21-67 .专门适用于在制造或处理过程中处理半导体或电固体器件的装置;专门适合于在半导体或电固体器件或部件的制造或处理过程中处理晶片的装置
H01L21-70 .由在一共用基片内或其上形成的多个固态组件或集成电路组成的器件或其部件的制造或处理;集成电路器件或其特殊部件的制造