[发明专利]行交织控制器、包括其的图像信号处理器和应用处理器在审
申请号: | 202110366674.3 | 申请日: | 2021-04-06 |
公开(公告)号: | CN113784013A | 公开(公告)日: | 2021-12-10 |
发明(设计)人: | 车佶炯;朴珍秀;李东禹;李瑞勋;许承镇 | 申请(专利权)人: | 三星电子株式会社 |
主分类号: | H04N5/14 | 分类号: | H04N5/14;H04N5/217;H04N5/232;H04N9/04 |
代理公司: | 北京天昊联合知识产权代理有限公司 11112 | 代理人: | 赵南;张帆 |
地址: | 韩国*** | 国省代码: | 暂无信息 |
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摘要: | |||
搜索关键词: | 交织 控制器 包括 图像 信号 处理器 应用 | ||
1.一种图像信号处理器,包括:
行交织控制器,其被配置为接收图像帧中包括的多个图像数据行,产生对应于所述图像帧的一个或多个虚拟数据行,并且逐行按次序地输出所述多个图像数据行和所述虚拟数据行;以及
图像信号处理器核,其包括至少一个管线电路,所述管线电路包括串联连接以顺序地处理从所述行交织控制器接收到的数据行的多个处理模块,所述行交织控制器被配置为基于所述虚拟数据行处理所述图像帧的端部中包括的一个或多个端部图像数据行。
2.根据权利要求1所述的图像信号处理器,其中,所述多个处理模块包括:
一个或多个延迟的处理模块,其各自被配置为基于在待处理的目标数据行之后接收到的一个或多个延迟的数据行对所述目标数据行执行延迟的滤波操作。
3.根据权利要求2所述的图像信号处理器,其中,所述图像信号处理器核与从所述行交织控制器接收到的所述虚拟数据行同步地对所述端部图像数据行即时执行所述延迟的滤波操作,并且所述图像信号处理器在所述图像信号处理器核对所述端部图像数据行执行所述延迟的滤波操作的同时从所述行交织控制器接收数据行。
4.根据权利要求2所述的图像信号处理器,其中,所述行交织控制器基于所述延迟的处理模块的模块延迟大小来确定所述虚拟数据行的数量,各个模块延迟大小指示各个延迟的处理模块的延迟数据行的数量。
5.根据权利要求4所述的图像信号处理器,其中,所述图像信号处理器核包括单个管线电路,并且
其中,所述行交织控制器产生和输出所述虚拟数据行,使得所述虚拟数据行的数量等于所述单个管线电路中包括的延迟的处理模块的模块延迟大小之和。
6.根据权利要求4所述的图像信号处理器,其中,各个延迟的处理模块利用第一数量的接收到的虚拟数据行对所述端部图像数据行执行所述延迟的滤波操作,并且输出第二数量的接收到的虚拟数据行,而不处理,所述第一数量对应于各个延迟的处理模块的模块延迟大小,所述第二数量对应于各个延迟的处理模块的延迟的滤波操作中不使用的接收到的虚拟数据行。
7.根据权利要求4所述的图像信号处理器,其中,所述图像信号处理器核包括:
第一管线电路,其包括一个或多个第一延迟的处理模块;以及
第二管线电路,其包括一个或多个第二延迟的处理模块,所述第一管线电路与所述第一管线电路并联连接。
8.根据权利要求7所述的图像信号处理器,其中,所述行交织控制器产生并输出所述虚拟数据行,使得所述虚拟数据行的数量等于第一管线延迟大小和第二管线延迟大小中的较大的一个,所述第一管线延迟大小对应于的所述第一管线电路中包括的延迟的处理模块的模块延迟大小之和,所述第二管线延迟大小对应于所述第二管线电路中包括的延迟的处理模块的模块延迟大小之和。
9.根据权利要求7所述的图像信号处理器,其中,所述图像信号处理器核还包括:
混合器,其被配置为将所述第一管线电路和所述第二管线电路的输出混合。
10.根据权利要求9所述的图像信号处理器,其中,所述第一管线电路和所述第二管线电路之一包括:
延迟缓冲器,其被配置为延迟接收到的数据行而不处理,使得所述第一管线延迟大小和所述第二管线延迟大小变得彼此相等。
11.根据权利要求1所述的图像信号处理器,其中,所述行交织控制器通过第一信道接收第一图像帧中包括的多个第一图像数据行和通过第二信道接收第二图像帧中包括的多个第二图像数据行,产生对应于所述第一图像帧的一个或多个第一虚拟数据行和对应于所述第二图像帧的一个或多个第二虚拟数据行,并且利用时分复用方案将所述多个第一图像数据行、所述多个第二图像数据行、所述第一虚拟数据行和所述第二虚拟数据行逐行按次序地传递至所述图像信号处理器核。
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