[发明专利]并行低等待时间知悉在审
| 申请号： | 202010777527.0 | 申请日： | 2016-01-13 |
| 公开（公告）号： | CN111901092A | 公开（公告）日： | 2020-11-06 |
| 发明（设计）人： | 陈万士;D·P·玛拉迪;P·盖尔;Y·魏;H·徐;S·A·帕特尔;A·达蒙佳诺维克 | 申请（专利权）人： | 高通股份有限公司 |
| 主分类号： | H04L5/00 | 分类号： | H04L5/00;H04W72/12 |
| 代理公司： | 上海专利商标事务所有限公司 31100 | 代理人： | 陈炜 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 本申请涉及并行低等待时间知悉。描述了用于无线通信的方法、系统和设备。接收方设备可以检测与低等待时间传输相关联的信号并相应地解码非低等待时间通信。接收方设备可以接收来自传送方设备的指示低等待时间通信在何处以及何时发生的指示符。该指示可以指定低等待时间通信所使用的频率资源或码元。该指示符可以在与低等待时间通信相同的子帧期间、在子帧的结束处、或者在后续子帧期间传送。接收方设备可以使用该指示符来减轻低等待时间干扰，生成信道估计，以及可靠地解码非低等待时间通信。在一些情形中，干扰方低等待时间通信可发生在接收方设备的服务蜂窝小区内；或者，干扰方低等待时间通信可发生在邻蜂窝小区中。 | ||
| 搜索关键词： | 并行 等待时间 知悉 | ||
【主权项】：
暂无信息
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