[发明专利]一种乒乓缓存控制器及其设计方法在审
| 申请号： | 201810280280.4 | 申请日： | 2018-04-02 |
| 公开（公告）号： | CN108536615A | 公开（公告）日： | 2018-09-14 |
| 发明（设计）人： | 于锦辉 | 申请（专利权）人： | 郑州云海信息技术有限公司 |
| 主分类号： | G06F12/08 | 分类号： | G06F12/08 |
| 代理公司： | 济南诚智商标专利事务所有限公司 37105 | 代理人： | 王汝银 |
| 地址： | 450018 河南省郑州市*** | 国省代码： | 河南;41 |
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| 摘要： | 本发明提供了一种乒乓缓存控制器及其设计方法，所述的系统包括Cyclone V SoC芯片和DDR，所述的Cyclone V SoC芯片包括FPGA端和HPS端，所述的FPGA端采集到VGA视频数据，经过JPEG IP核的压缩处理，转换为一帧一帧的JPEG格式数据，通过乒乓缓存控制器的控制，将JPEG数据经由HPS端的DDR Controller和I/O接口写入DDR，所述的HPS端通过乒乓缓存控制器的控制将JPEG数据从对应的DDR空间中读出并上传至上位机。所述的方法包括：新建一个Quartus工程；在插件Qsys中添加HPS；编辑HPS，添加一个FPGA‑to‑HPS Interface并选择为64位的AXI‑3；在Qsys中添加两个inout型的PIO h2f_a和h2f_b；设计乒乓缓存控制器FPGA端流程和HPS端流程。解决了数据量较大时FPGA内部存储空间小的问题，采用乒乓缓存结构，充分保证了数据传输的流畅性。 | ||
| 搜索关键词： | 乒乓缓存 控制器 乒乓缓存结构 内部存储 数据传输 压缩处理 流畅性 数据量 插件 上传 位机 读出 写入 采集 转换 保证 | ||
【主权项】：
1.一种乒乓缓存控制器，其特征是：所述的系统包括Cyclone V SoC芯片和DDR，所述的Cyclone V SoC芯片包括FPGA端和HPS端，所述的FPGA端采集到VGA视频数据，经过JPEG IP核的压缩处理，转换为一帧一帧的JPEG格式数据，通过乒乓缓存控制器的控制，将JPEG数据经由HPS端的DDR Controller和I/O接口写入DDR，所述的HPS端通过乒乓缓存控制器的控制将JPEG数据从对应的DDR空间中读出并上传至上位机。
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