[发明专利]用于混淆具有伪装门和逻辑加密的集成电路的系统和方法在审
| 申请号： | 201780057579.7 | 申请日： | 2017-09-19 |
| 公开（公告）号： | CN109791576A | 公开（公告）日： | 2019-05-21 |
| 发明（设计）人： | B·J·王;L·W·周;R·P·科驰;J·P·鲍库斯 | 申请（专利权）人： | 英赛瑟库尔公司 |
| 主分类号： | G06F17/50 | 分类号： | G06F17/50;H01L21/314;H01L21/82;H01L23/58;H01L27/02 |
| 代理公司： | 北京市中咨律师事务所 11247 | 代理人： | 杨晓光;于静 |
| 地址： | 法国*** | 国省代码： | 法国;FR |
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| 摘要： | 公开了一种用于混淆集成电路的至少一部分的方法和装置。在一个实施例中，该方法包括对于集成电路的部分的每个网络，计算可观察点的数量(COP)，对于每个网络，计算选择权重(WS)，以及基于计算的选择权重(WS)来选择用于插入至少一个保护元件的一个或多个网络。 | ||
| 搜索关键词： | 集成电路 选择权 混淆 方法和装置 网络 逻辑加密 可观察 伪装 | ||
【主权项】：
1.一种混淆具有包括逻辑元件和存储元件的多个元件的集成电路的至少一部分的方法，所述集成电路包括具有两个或多个互连元件的多个网络，所述方法包括：对于所述集成电路的所述部分的每个网络，计算可观察点的数量(COP)；对于每个网络，计算选择权重(WS)；以及基于所计算的选择权重(WS)选择用于插入至少一个保护元件的一个或多个网络。
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