[发明专利]基于FPGA异构平台的马尔科夫蒙特卡洛算法加速方法在审
| 申请号： | 201710632320.2 | 申请日： | 2017-07-28 |
| 公开（公告）号： | CN107423030A | 公开（公告）日： | 2017-12-01 |
| 发明（设计）人： | 张新;陈继承;王洪伟 | 申请（专利权）人： | 郑州云海信息技术有限公司 |
| 主分类号： | G06F9/38 | 分类号： | G06F9/38 |
| 代理公司： | 北京集佳知识产权代理有限公司11227 | 代理人： | 罗满 |
| 地址： | 450018 河南省郑州市*** | 国省代码： | 河南;41 |
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| 摘要： | 本发明公开了一种基于FPGA异构平台的马尔科夫蒙特卡洛算法加速方法及系统，该方法包括主机端完成初始化，并将产生的随机数数据通过PCI‑e接口发送到FPGA端的DDR内存；其中，初始化包括构造概率空间和产生随机数；FPGA端读取DDR内存中的随机数数据，并利用构造的马尔科夫链对随机数数据进行并行的流水线运算，获取并发送对应的结果数据到主机端；本发明通过FPGA端读取DDR内存中的随机数数据，并利用构造的马尔科夫链对随机数数据进行并行的流水线运算，可以利用FPGA板卡中构造的马尔科夫链采用并行加流水线的方式完成蒙特卡洛算法核心计算过程，减少了成本，提高了并行效率。 | ||
| 搜索关键词： | 基于 fpga 平台 马尔科夫蒙特卡洛 算法 加速 方法 | ||
【主权项】：
一种基于FPGA异构平台的马尔科夫蒙特卡洛算法加速方法，其特征在于，包括：主机端完成初始化，并将产生的随机数数据通过PCI‑e接口发送到FPGA端的DDR内存；其中，所述初始化包括构造概率空间和产生随机数；所述FPGA端读取所述DDR内存中的所述随机数数据，并利用构造的马尔科夫链对所述随机数数据进行并行的流水线运算，获取并发送对应的结果数据到所述主机端。
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