[实用新型]使用数字同步逻辑控制电路的DCDC变换器有效
| 申请号： | 201620796547.1 | 申请日： | 2016-07-27 |
| 公开（公告）号： | CN205883049U | 公开（公告）日： | 2017-01-11 |
| 发明（设计）人： | 申请（专利权）人： | ||
| 主分类号： | H02M3/157 | 分类号： | H02M3/157;H03K19/20 |
| 代理公司： | 杭州华鼎知识产权代理事务所(普通合伙)33217 | 代理人： | 魏亮 |
| 地址： | 314000 浙江省嘉兴市南湖区*** | 国省代码： | 浙江;33 |
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| 摘要： | 本实用新型涉及一种使用数字同步逻辑控制电路的DCDC变换器，其特征在于，接收外部的第一时钟信号；包括用于产生第二时钟信号的振荡器模块及接收所述第一时钟信号及第二时钟信号的同步与时钟控制模块；当所述第一时钟信号存在时，所述同步与时钟控制模块输出所述第一时钟信号，当所述第一时钟信号不存在时，所述同步与时钟控制模块输出所述第二时钟信号；还包括接收所述第一时钟信号或第二时钟信号并输出的时钟缓冲模块。本实用新型的DCDC变换器结构不用外接外部同步电路也能实现多组DCDC变换器的同步逻辑功能，提高了芯片的集成度和使用的方便性。 | ||
| 搜索关键词： | 使用 数字 同步 逻辑 控制电路 dcdc 变换器 | ||
【主权项】：
使用数字同步逻辑控制电路的DCDC变换器，其特征在于，接收外部的第一时钟信号；包括用于产生第二时钟信号的振荡器模块及接收所述第一时钟信号及第二时钟信号的同步与时钟控制模块；当所述第一时钟信号存在时，所述同步与时钟控制模块输出所述第一时钟信号，当所述第一时钟信号不存在时，所述同步与时钟控制模块输出所述第二时钟信号；还包括接收所述第一时钟信号或第二时钟信号并输出的时钟缓冲模块。
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