[实用新型]具动态设定错误更正码组态的结构有效
| 申请号： | 201620483940.5 | 申请日： | 2016-05-25 |
| 公开（公告）号： | CN205721749U | 公开（公告）日： | 2016-11-23 |
| 发明（设计）人： | 陈炳杰;陈孟豪 | 申请（专利权）人： | 点序科技股份有限公司 |
| 主分类号： | G06F11/10 | 分类号： | G06F11/10 |
| 代理公司： | 长沙正奇专利事务所有限责任公司 43113 | 代理人： | 何为;袁颖华 |
| 地址： | 中国台湾新竹*** | 国省代码： | 中国台湾;71 |
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| 摘要： | 一种具动态设定错误更正码组态的结构，其包含有一主机装置；一与主机装置连接的直接内存访问单元；一与主机装置连接的错误码侦测单元；一与主机装置连接的中央处理器；一与主机装置连接的缓冲存储器；一与缓冲存储器连接的群组区分单元；以及一与主机装置连接的闪存。藉此，可对闪存进行测试评估后分为若干群组，而各群组各有对应的优化错误更正码组态与内存页面，并依据组态选择任一群组对应写入数据，而达到增加闪存可靠度的功效。 | ||
| 搜索关键词： | 动态 设定 错误 更正 组态 结构 | ||
【主权项】：
一种具动态设定错误更正码组态的结构，其特征在于，其包括有一主机装置、一直接内存访问单元、一错误码侦测单元、一中央处理器、一缓冲存储器、一群组区分单元及闪存，该直接内存访问单元、错误码侦测单元、中央处理器、缓冲存储器及闪存皆与主机装置连接；该群组区分单元与该缓冲存储器连接。
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