[发明专利]一种ARM处理器与FPGA双向数据传输的实现方法有效
| 申请号： | 201611043907.1 | 申请日： | 2016-11-21 |
| 公开（公告）号： | CN106776408B | 公开（公告）日： | 2019-11-22 |
| 发明（设计）人： | 何磊 | 申请（专利权）人： | 奕瑞影像科技(太仓)有限公司 |
| 主分类号： | G06F13/38 | 分类号： | G06F13/38 |
| 代理公司： | 31219 上海光华专利事务所(普通合伙) | 代理人： | 姚艳<国际申请>=<国际公布>=<进入国 |
| 地址： | 215434 江苏省苏州市太*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明提供一种ARM处理器与FPGA双向数据传输的实现方法，至少包括：构建所述ARM处理器的数据传输接口；配置所述ARM处理器的数据传输接口的数据传输方式；提供具有与所述ARM处理器的数据传输接口及其数据传输方式相匹配的数据传输接口的FPGA；将所述ARM处理器与所述FPGA通过其各自的数据传输接口连接，以实现所述ARM处理器与所述FPGA的双向数据传输。本发明利用NXP ARM处理器的EIM接口的部分构成和信号，同时引入ARM处理器的部分GPIO管脚，构建了一个可与FPGA双向高速并行数据传输的接口，简化了EIM接口的信号连接方式，降低了FPGA与ARM处理器数据传输的开发成本和开发难度。 | ||
| 搜索关键词： | 一种 arm 处理器 fpga 双向 数据传输 实现 方法 | ||
【主权项】：
1.一种ARM处理器与FPGA双向数据传输的实现方法，所述ARM处理器至少包括EIM接口和多个GPIO管脚，所述EIM接口至少包括32根数据线、16根地址数据复用线、1根时钟线、4根片选线、1根输出使能线和1根地址有效线，其特征在于，所述ARM处理器与FPGA双向数据传输的实现方法至少包括：/n构建所述ARM处理器的数据传输接口；其中，所述ARM处理器的数据传输接口至少包括：由所述EIM接口提供的至少8根数据线、1根时钟线、1根片选线、1根输出使能线和1根地址有效线，以及由所述ARM处理器提供的至少2个GPIO管脚；/n配置所述ARM处理器的数据传输接口的数据传输方式；其中，配置所述数据线供所述ARM处理器和所述FPGA之间双向数据传输，配置所述时钟线供所述ARM处理器向所述FPGA发送时钟信号，配置所述片选线供所述ARM处理器向所述FPGA发送片选信号，配置所述输出使能线供所述ARM处理器向所述FPGA发送输出使能信号，配置所述地址有效线供所述ARM处理器向所述FPGA发送地址有效信号，配置第一GPIO管脚供所述ARM处理器向所述FPGA发送读/写信号，配置第二GPIO管脚供所述ARM处理器向所述FPGA发送数据传输开始信号；/n提供具有与所述ARM处理器的数据传输接口及其数据传输方式相匹配的数据传输接口的FPGA；/n将所述ARM处理器与所述FPGA通过其各自的数据传输接口连接，以实现所述ARM处理器与所述FPGA的双向数据传输。/n
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