[发明专利]一种非易失性存储器在审

专利信息
申请号: 201611037221.1 申请日: 2016-11-18
公开(公告)号: CN108074617A 公开(公告)日: 2018-05-25
发明(设计)人: 周耀;倪昊 申请(专利权)人: 中芯国际集成电路制造(上海)有限公司;中芯国际集成电路制造(北京)有限公司
主分类号: G11C16/26 分类号: G11C16/26;G11C16/06
代理公司: 北京集佳知识产权代理有限公司 11227 代理人: 张振军;吴敏
地址: 201203 *** 国省代码: 上海;31
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摘要: 一种非易失性存储器,包括:第一和第二阵列库,分别耦接第一和第二位线;第一选通电路,适于在地址使能信号的作用下,连通所述预充电电路的第一输出端与所述第一位线,并连通所述预充电电路的第二输出端与所述第二位线,以对所述第一位线和第二位线充电,或者断开预充电电路与第一位线和第二位线的连接;灵敏放大器,其第一输入端耦接预充电电路的第一输出端,其第二输入端耦接预充电电路的第二输出端,灵敏放大器输出的比较结果指示第一或第二阵列库所存储的数据信息;第二选通电路,适于在第一和第二字线信号的作用下,控制参考电流流入至灵敏放大器的第一和第二输入端其中之一。本发明方案可有效降低非易失性存储器的数据读取时间。
搜索关键词: 位线 预充电电路 输出端 非易失性存储器 灵敏放大器 输入端 耦接 选通电路 连通 参考电流 使能信号 数据读取 数据信息 字线信号 断开 充电 存储 输出
【主权项】:
1.一种非易失性存储器,包括:第一阵列库和第二阵列库,其中,所述第一阵列库和第二阵列库分别包括多个存储器单元,所述第一阵列库耦接第一位线,所述第二阵列库耦接第二位线,当所述第一阵列库和第二阵列库其中之一受控进行读操作时,另一个为进行读操作的阵列库的伪阵列库;其特征在于,还包括:预充电电路;第一选通电路,适于在地址使能信号的作用下,连通所述预充电电路的第一输出端与所述第一位线,并连通所述预充电电路的第二输出端与所述第二位线,以对所述第一位线和第二位线充电;或者,断开所述预充电电路的第一输出端与所述第一位线的连接,以及一并断开所述预充电电路的第二输出端与所述第二位线的连接;灵敏放大器,其第一输入端耦接所述预充电电路的第一输出端以接收第一电压,其第二输入端耦接所述预充电电路的第二输出端以接收第二电压,所述灵敏放大器适于通过对第一电压和第二电压比较得到比较结果,所述比较结果指示所述第一阵列库或第二阵列库所存储的数据信息;第二选通电路,适于在第一字线信号和第二字线信号的作用下,控制参考电流流入至所述灵敏放大器的第一输入端和第二输入端其中之一。
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