[实用新型]数模转换器DAC以及数模转换器DAC中的第一子DAC有效
申请号: | 201520723223.0 | 申请日: | 2015-09-17 |
公开(公告)号: | CN205081772U | 公开(公告)日: | 2016-03-09 |
发明(设计)人: | J·L·沃利;M·奥尔沃迪 | 申请(专利权)人: | 意法半导体公司 |
主分类号: | H03M1/66 | 分类号: | H03M1/66 |
代理公司: | 北京市金杜律师事务所 11256 | 代理人: | 王茂华;张曦 |
地址: | 美国得*** | 国省代码: | 美国;US |
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摘要: | 一种数模转换器DAC以及数模转换器DAC中的第一子DAC,其中,数模转换器DAC可以包括被配置为接收数字输入信号的解码器、以及并联地耦合至解码器的第一和第二子DAC,第一和第二子DAC中的每个子DAC具有第一LSB库和第二LSB库以及耦合在第一LSB库与第二LSB库之间的MSB库。解码器可以被配置为基于数字输入信号来选择性地控制第一LSB库和第二LSB库以及MSB库。该DAC可以包括输出网络,该输出网络耦合至第一子DAC和第二子DAC并且被配置为生成与数字输入信号相关的模拟输出信号。 | ||
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【主权项】:
一种数模转换器DAC,其特征在于,所述DAC包括:解码器,被配置为接收数字输入信号;并联地耦合至所述解码器的第一子DAC和第二子DAC,所述第一子DAC和所述第二子DAC中的每个子DAC包括第一最低有效位LSB库和第二LSB库以及最高有效位MSB库,所述MSB库耦合在所述第一LSB库与所述第二LSB库之间;所述解码器被配置为基于所述数字输入信号来选择性地控制所述第一LSB库和所述第二LSB库以及所述MSB库;以及输出网络,所述输出网络耦合至所述第一子DAC和所述第二子DAC并且被配置为生成与所述数字输入信号相关的模拟输出信号。
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