[发明专利]带隙基准源的钳位电路有效
申请号: | 201210496253.3 | 申请日: | 2012-11-28 |
公开(公告)号: | CN103853223A | 公开(公告)日: | 2014-06-11 |
发明(设计)人: | 周宁 | 申请(专利权)人: | 上海华虹宏力半导体制造有限公司 |
主分类号: | G05F1/567 | 分类号: | G05F1/567 |
代理公司: | 上海浦一知识产权代理有限公司 31211 | 代理人: | 丁纪铁 |
地址: | 201203 上海市浦东*** | 国省代码: | 上海;31 |
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摘要: | 本发明公开了一种带隙基准源的钳位电路,是在带隙基准源的电源电压与外部电源电压之间串接一钳位电路,所述钳位电路可有效抑制电源电压的瞬间跳变,为带隙基准源提供相对稳定的电源电压,使其输出稳定的基准电压,从而抑制电源电压瞬间跳变对基准电压的影响。 | ||
搜索关键词: | 基准 电路 | ||
【主权项】:
一种带隙基准源的钳位电路,对带隙基准源的输入电压进行钳位稳压,其特征在于:包含2个PMOS组成输入级,以及6只NMOS构成钳位稳压电路;两PMOS的两源极并联以及两栅极并联后,形成两输入端,并联的源极连接电源输入电压,并联的栅极连接偏置电流源,以形成偏置电流源的镜像电流;第五NMOS的栅极与漏极短接后连接第一PMOS的漏极,第五NMOS的源极接地;第六NMOS的栅漏短接后连接第二PMOS的漏极,第一NMOS的栅漏短接后连接第六NMOS的源极,第一NMOS的源极接地;第二NMOS的栅极连接第二PMOS的漏极,其漏极连接第二PMOS的源极;第三NMOS的栅极与第四NMOS的栅极并联后连接第五NMOS的漏极,第三NMOS的源极与第四NMOS的漏极连接,第四NMOS的源极接地,第三NMOS的漏极与第二NMOS的源极连接并引出所述钳位电路的稳压输出端。
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