[发明专利]一种基于乒乓机制的FPGA与DSP数据传输系统无效
| 申请号： | 201210401211.7 | 申请日： | 2012-10-19 |
| 公开（公告）号： | CN102968394A | 公开（公告）日： | 2013-03-13 |
| 发明（设计）人： | 张旭明;郭富民;王垠琪;李柳;丁明跃;熊有伦;尹周平;王瑜辉 | 申请（专利权）人： | 华中科技大学 |
| 主分类号： | G06F13/16 | 分类号： | G06F13/16;G06F5/16 |
| 代理公司： | 华中科技大学专利中心 42201 | 代理人： | 李智 |
| 地址： | 430074 湖北*** | 国省代码： | 湖北;42 |
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| 摘要： | 本发明提供了一种基于乒乓机制的FPGA与DSP数据传输系统，包括双通道切换开关、FPGA、DSP和两存储器，FPGA控制双通道切换开关的开关状态以实现第一读写通道和第二读写通道的交替进行，从而实现数据的交替存储与读取；所述第一读写通道为：FPGA将自身缓存的当前数据写入第一存储器，同时DSP从第二存储器读取前一时刻写入的数据；所述第二读写通道为：FPGA将自身缓存的当前数据写入第二存储器，同时DSP从第一存储器读取前一时刻写入的数据。本发明通过乒乓的方式将连续数据在两块DDR2 SDRAM之间轮番交替存储和读取，节省等待时间，提高数据传输效率。 | ||
| 搜索关键词： | 一种 基于 乒乓 机制 fpga dsp 数据传输 系统 | ||
【主权项】：
一种基于乒乓机制的FPGA与DSP数据传输系统，包括双通道切换开关、FPGA、DSP和两存储器，FPGA控制双通道切换开关的开关状态以实现第一读写通道和第二读写通道的交替进行，从而实现数据的交替存储与读取；所述第一读写通道为：FPGA将自身缓存的当前数据写入第一存储器，同时DSP从第二存储器读取前一时刻写入的数据；所述第二读写通道为：FPGA将自身缓存的当前数据写入第二存储器，同时DSP从第一存储器读取前一时刻写入的数据。
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