[发明专利]非易失性存储门及其动作方法、及非易失性存储门装入型逻辑电路及其动作方法有效
| 申请号： | 200980107095.4 | 申请日： | 2009-01-08 |
| 公开（公告）号： | CN101960719A | 公开（公告）日： | 2011-01-26 |
| 发明（设计）人： | 木村启明;渊上贵昭;藤森敬和 | 申请（专利权）人： | 罗姆股份有限公司 |
| 主分类号： | H03K19/00 | 分类号： | H03K19/00 |
| 代理公司： | 北京尚诚知识产权代理有限公司 11322 | 代理人： | 龙淳 |
| 地址： | 日本*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明提供一种非易失性存储门装入型逻辑电路，其装入电源断开后也可以保持数据的非易失性存储门，当进入待机状态时，可以同时断开电源。非易失性存储门装入型逻辑电路(10)具备具有逻辑门(16)的逻辑运算部(14)和非易失性存储门(12)，所述非易失性存储门(12)具有：非易失性存储部(18)；数据接口控制部(22)，其邻接于非易失性存储部(18)而配置，接收用于向非易失性存储部(18)的数据写入及从非易失性存储部(18)的数据读取的非易失性存储控制信号(NVCTL)；易失性存储部(24)，其邻接于非易失性存储部(18)而配置，接收数据输入信号(D)及时钟信号(CLK)，输出数据输出信号(Q)。 | ||
| 搜索关键词： | 非易失性 存储 及其 动作 方法 装入 逻辑电路 | ||
【主权项】：
一种非易失性存储门，其特征在于，具备：非易失性存储部；数据接口控制部，其邻接于所述非易失性存储部而配置，接收用于向所述非易失性存储部的数据写入和从所述非易失性存储部的数据读取的非易失性存储控制信号；和易失性存储部，其邻接于所述非易失性存储部而配置，接收数据输入信号和时钟信号，输出数据输出信号。
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