[发明专利]一种兼容多速率的数字中频实现装置及方法有效
| 申请号： | 200810241975.8 | 申请日： | 2008-12-31 |
| 公开（公告）号： | CN101478513A | 公开（公告）日： | 2009-07-08 |
| 发明（设计）人： | 廖艳 | 申请（专利权）人： | 中兴通讯股份有限公司 |
| 主分类号： | H04L25/49 | 分类号： | H04L25/49 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 518057广东省深圳市南山*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明涉及一种数字中频信号处理领域兼容多速率的FPGA实现装置和方法，本发明技术方案如下：一种兼容多速率的数字中频实现装置，由子模块组成，其特征在于：设置所述子模块为最高速率，并向下兼容其他速率；各子模块均包括一输入输出控制模块，第一级子模块输入输出控制模块用于根据上层软件配置的基带信号带宽产生初始的数据输入时序控制逻辑，并将所述数据输入时序控制逻辑作为初始输入有效信号，并向下一级子模块输出输出有效信号；次级子模块输入输出控制模块用于读取上一级所述输出有效信号作为本级输入有效信号，并向下一级输出输出有效信号。并提供了上述装置处理的方法。采用本发明装置及方法设计简单，仿真方便，兼容多速率。 | ||
| 搜索关键词： | 一种 兼容 速率 数字 中频 实现 装置 方法 | ||
【主权项】：
1. 一种兼容多速率的数字中频实现装置，由子模块组成，其特征在于：设置所述子模块为最高速率，并向下兼容其他速率；各子模块均包括一输入输出控制模块，第一级子模块输入输出控制模块用于根据上层软件配置的基带信号带宽产生初始的数据输入时序控制逻辑，并将所述数据输入时序控制逻辑作为初始输入有效信号，并向下一级子模块输出输出有效信号；次级子模块输入输出控制模块用于读取上一级所述输出有效信号作为本级输入有效信号，并向下一级输出输出有效信号。
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