[发明专利]信号处理电路无效
| 申请号： | 200810085205.9 | 申请日： | 2008-03-06 |
| 公开（公告）号： | CN101266574A | 公开（公告）日： | 2008-09-17 |
| 发明（设计）人： | 藤村健介 | 申请（专利权）人： | 三洋电机株式会社;三洋半导体株式会社 |
| 主分类号： | G06F12/02 | 分类号： | G06F12/02 |
| 代理公司： | 中科专利商标代理有限责任公司 | 代理人： | 李贵亮 |
| 地址： | 日本国*** | 国省代码： | 日本;JP |
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| 摘要： | 本发明提供一种信号处理电路，其中具备：信号处理部，其生成与数据处理对应的第1地址和第2地址，并根据第1地址和第2地址，读出存储于外部存储器的数据后进行规定的处理，并且与第1地址和第2地址一起输出处理过的数据；地址变换部，其输入第1地址或第2地址，保持第1地址中的至少一个比特，输出第3地址，并且将所保持的第1地址中的至少一个比特追加到第2地址中，输出第4地址；和数据接口，其根据地址变换部输出第3地址和第4地址的定时，将信号处理部处理的数据相对于外部存储器进行写入、或者读出处理。因此，可以抑制由于所连接的外部存储器的容量增加而引起的成本增加，并且可以较佳地对外部存储器进行存取。 | ||
| 搜索关键词： | 信号 处理 电路 | ||
【主权项】：
1.一种信号处理电路，包括：信号处理部，其生成与数据处理对应的第1地址和第2地址，根据上述第1地址和上述第2地址，读出存储于外部存储器的数据后，进行规定的处理，并且将处理后的数据与上述第1地址和上述第2地址一起输出；地址变换部，其输入上述第1地址或上述第2地址，保持上述第1地址中的至少1比特，输出第3地址，并且将所保持的上述第1地址中的至少1比特追加到上述第2地址后，输出第4地址；和数据接口，其根据上述地址变换部输出上述第3地址和上述第4地址的定时，将上述信号处理部处理的数据相对于上述外部存储器进行写入或者读出处理。
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