[发明专利]提高先入先出FIFO性能的方法和先入先出FIFO电路无效
| 申请号： | 200710064252.0 | 申请日： | 2007-03-07 |
| 公开（公告）号： | CN101017429A | 公开（公告）日： | 2007-08-15 |
| 发明（设计）人： | 余娜敏 | 申请（专利权）人： | 北京中星微电子有限公司 |
| 主分类号： | G06F5/06 | 分类号： | G06F5/06 |
| 代理公司： | 北京同达信恒知识产权代理有限公司 | 代理人： | 李欣 |
| 地址： | 100083北京市*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明公开了一种提高先入先出FIFO性能的方法和FIFO电路，其通过三级寄存器的方法实现数据的压入和弹出，由于当第二级或第三级寄存器空闲时，所述第一选择器的输出数据只需要压入空闲的寄存器，因此本发明不仅能够节省电路面积，而且能够减少关键路径的时延。 | ||
| 搜索关键词： | 提高 先入先出 fifo 性能 方法 电路 | ||
【主权项】：
1、一种提高先入先出FIFO性能的方法，其特征在于，包括：在写入数据时，判断第三级寄存器在下一个时钟周期是否为空；如果所述第三级寄存器在下一个时钟周期为空，则从所述第一选择器中选择出数据，并将其传输给所述第三级寄存器；如果所述第三级寄存器在下一个时钟周期不为空，则判断第二级寄存器在下一个时钟周期是否为空，若为空，则从所述第一选择器中选择出一个数据，并将其传输给第二级寄存器，所述第二级寄存器将数据压入，并弹出数据传输给所述第三级寄存器；若第二级寄存器在下一个时钟周期不为空，则从所述第一选择器中选择出一个数据，并将其传输给第一级寄存器，并当第二级寄存器或第三级寄存器不为满时，从所述第一级寄存器中输出数据给所述第二级寄存器，所述第二级寄存器输出数据给所述第三级寄存器；所述第三级寄存器将数据压入，以及弹出数据，并传输给第二选择器。
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